職責描述：
develop FPGA design process including requirements generation, preliminary design, peer reviews, detailed design, test plan generation, and test
FPGA設計， 包括需求分析，驗證設計，評審，代碼設計，測試計劃和測試
develop digital logic design using Xilinx UltraScale and/or a Arria & Stratix FPGAs
使用主流FPGA設計數(shù)字電路
Close design timing with rstanding of static timing analysis
使用靜態(tài)時序分析和優(yōu)化設計時序
generate FPGA designs using Vivado or Quartus tool suite
使用工具生成設計
Other tasks assigned by the leader
其它未盡事宜

任職要求：
BS Degree in electrical/computer engineering and 3+ years of related experience with FPGA Design
電子工程、計算機等相關專業(yè)，本科或以上學歷；3年相關經(jīng)驗
Experience using Mentor Questa/ModelSim Simulator
熟悉時序仿真工具
Experience integrating with HW/software and supporting the complete testing
熟悉軟硬件集成測試
Good written and written English
具有良好的英文文獻讀寫能力

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